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ISL6115, ISL6116, ISL6117, ISL6120
Simplified Block Diagram
S
I SET
-
+
UV
V DD
+
-
+
8V
-
POR
QN R
R
Q
PWRON
I SEN
+
-
V REF
ENABLE
1 2V
PGOOD
7.5k
+
GATE
10μA
18V
ISL61xx
UV DISABLE
OC
FALLING
EDGE
DELAY
ENABLE
+
-
-
WOCLIM
CLIM
20μA
+
-
1.86V
20μA
+
-
CTIM
V SS
18V
RISING
EDGE
V DD
PULSE
Pin Configuration
ISL6115, ISL6116, ISL6117, ISL6120
(8 LD SOIC)
TOP VIEW
Ordering Information
ISET
ISEN
GATE
VSS
1
2
3
4
8 PWRON
7 PGOOD
6 CTIM
5 VDD
PART
PART
TEMP.
PKG.
NUMBER
ISL6115CB (Note 1)
ISL6115CBZA (Notes 1, 2)
ISL6116CBZA (Notes 1, 2)
ISL6117CBZA (Notes 1, 2)
ISL6120CBZA (Notes 1, 2)
MARKING
ISL61 15CB
6115 CBZ
6116 CBZ
6117 CBZ
6120 CBZ
RANGE (°C)
0 to +85
0 to +85
0 to +85
0 to +85
0 to +85
PACKAGE
8 Ld SOIC
8 Ld SOIC (Pb-free)
8 Ld SOIC (Pb-free)
8 Ld SOIC (Pb-free)
8 Ld SOIC (Pb-free)
DWG. #
M8.15
M8.15
M8.15
M8.15
M8.15
ISL6115EVAL1Z
Evaluation Platform
NOTES:
1. Please refer to TB347 for details on reel specifications. Add “-T” suffix for tape and reel.
2. These Intersil Pb-free plastic packaged products employ special Pb-free material sets, molding compounds/die attach
materials, and 100% matte tin plate plus anneal (e3 termination finish, which is RoHS compliant and compatible with both
SnPb and Pb-free soldering operations). Intersil Pb-free products are MSL classified at Pb-free peak reflow temperatures that
meet or exceed the Pb-free requirements of IPC/JEDEC J STD-020.
3. For Moisture Sensitivity Level (MSL), please see device information page for ISL6115 . For more information on MSL please see
2
FN9100.7
April 29, 2010
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